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基于CMOS忆阻器混合电路的递归神经网络研究与设计

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基于CMOS忆阻器混合电路的递归神经网络研究与设计
论文目录
 
摘要第1-6页
Abstract第6-12页
第1章 绪论第12-20页
  1.1 研究背景及意义第12-14页
  1.2 国内外研究现状第14-18页
    1.2.1 国外研究现状第14-17页
    1.2.2 国内研究现状第17-18页
  1.3 本文研究内容第18页
  1.4 本文的组织结构第18-20页
第2章 忆阻器与神经网络概述第20-36页
  2.1 忆阻器第20-26页
    2.1.1 忆阻器的定义第20-24页
    2.1.2 线性忆阻器的建模与分析第24-26页
  2.2 神经网络第26-32页
    2.2.1 神经网络原理第26-27页
    2.2.2 前馈神经网络第27-28页
    2.2.3 递归神经网络第28-31页
    2.2.4 递归神经网络的应用第31-32页
  2.3 忆阻神经网络第32-35页
    2.3.1 忆阻突触第32-33页
    2.3.2 神经网络电路训练策略第33-34页
    2.3.3 忆阻器在递归神经网络中的应用第34-35页
  2.4 小结第35-36页
第3章 基于忆阻器交叉阵列的递归神经网络第36-49页
  3.1 忆阻突触与神经元的设计第36-41页
    3.1.1 忆阻器交叉阵列电路设计第36-38页
    3.1.2 编码方案与神经元的设计第38-41页
  3.2 忆阻CW-RNN网络电路第41-43页
  3.3 实验与结果分析第43-48页
    3.3.1 分类性能分析第43-47页
    3.3.2 电路性能分析第47-48页
  3.4 小结第48-49页
第4章 通用型CW-RNN电路结构第49-59页
  4.1 CW-RNN中的忆阻器交叉阵列第49-51页
    4.1.1 输入-隐藏层之间的阵列结构(MC1)第49-50页
    4.1.2 隐藏层-隐藏层的阵列结构(MC2)第50-51页
  4.2 控制电路第51-54页
    4.2.1 忆阻器写控制电路第51-53页
    4.2.2 频率控制电路第53-54页
  4.3 总体结构第54-55页
  4.4 实验与结果分析第55-58页
    4.4.1 分类性能分析第55-57页
    4.4.2 电路性能分析第57-58页
  4.5 小结第58-59页
结论第59-61页
参考文献第61-67页
致谢第67页

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